M393T5750CZ3-CCC Samsung Semiconductor, M393T5750CZ3-CCC Datasheet - Page 11

• Manufacturer Part Number: M393T5750CZ3-CCC
• Manufacturer: Samsung Semiconductor

Specifications of M393T5750CZ3-CCC

• Lead Free Status / RoHS Status: Compliant

RDIMM
7.5 2GB, 256Mx72 Module (M393T5750CZA-CF7)
* S0 connects to DCS0 and S1 connects to DCS1 on both Registers.
** RESET, PCK7 and PCK7 connect to all Registers. Other signals connect to two Registers.
VSS
RS1
RS0
S0*
S1*
BA0-BA2
A0-A13
RAS
CAS
WE
CKE0
CKE1
ODT0
ODT1
RESET**
DQS0
DQS0
DQS2
DQS2
DQS3
DQS3
DQS1
DQS1
DQS4
DQS4
DQS5
DQS5
DQS6
DQS6
DQS7
DQS7
DQS8
DQS8
PCK7**
DQ0
DQ1
DQ2
DQ3
DQ8
DQ9
DQ10
DQ11
DQ16
DQ17
DQ18
DQ19
DQ24
DQ25
DQ26
DQ27
DQ40
DQ41
DQ42
DQ43
DQ48
DQ49
DQ50
DQ51
CB0
CB1
CB2
CB3
DQ32
DQ33
DQ34
DQ35
DQ56
DQ57
DQ58
DQ59
PCK7**
DM
DM
DM
DM
DM
DM
DM
DM
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
RST
CS DQS DQS
D0
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
D1
D2
D3
CS DQS DQS
D5
D6
CS DQS DQS
D4
D7
D8
1:2
G
R
E
S
T
E
R
I
RS0-> CS : DDR2 SDRAMs D0-D17
RS1-> CS : DDR2 SDRAMs D18-D35
RBA0-RBA2 -> BA0-BA2 : DDR2 SDRAMs D0-D35
RA0-RA13 -> A0-A13 : DDR2 SDRAMs D0-D35
RRAS -> RAS : DDR2 SDRAMs D0-D35
RCAS -> CAS : DDR2 SDRAMs D0-D35
RWE -> WE : DDR2 SDRAMs D0-D35
RCKE0 -> CKE : DDR2 SDRAMs D0-D17
RCKE1 -> CKE : DDR2 SDRAMs D18-D35
RODT0 -> ODT0 : DDR2 SDRAMs D0-D17
RODT1 -> ODT1 : DDR2 SDRAMs D18-D35
(populated as 2 rank of x4 DDR2 SDRAMs)
DM/
DM/
DM/
DM
DM
DM
DM
DM
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
CS DQS DQS
D18
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
D19
D20
D21
CS DQS DQS
D23
D24
CS DQS DQS
D26
D22
D25
DM0/DQS9
NC/DQS9
DM1/DQS10
NC/DQS10
DM2/DQS11
NC/DQS11
DM3/DQS12
NC/DQS12
DM5/DQS14
NC/DQS14
DM4/DQS13
NC/DQS13
DM6/DQS15
NC/DQS15
DM7DQS16
NC/DQS16
DM8/DQS17
NC/DQS17
DQ4
DQ5
DQ6
DQ7
DQ20
DQ21
DQ22
DQ23
DQ12
DQ13
DQ14
DQ15
DQ28
DQ29
DQ30
DQ31
DQ36
DQ37
DQ38
DQ39
DQ44
DQ45
DQ46
DQ47
DQ52
DQ53
DQ54
DQ55
DQ60
DQ61
DQ62
DQ63
CB4
CB5
CB6
CB7
DM
DM
DM
DM
DM
DM
DM
DM
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
11 of 25
CS DQS DQS
D9
CS DQS DQS
CS DQS DQS
D11
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
D10
D12
D13
D14
D15
D16
D17
RESET
CK0
CK0
DM
OE
DM
DM
DM
DM
DM
DM
DM
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
I/O 0
I/O 1
I/O 2
I/O 3
P
L
L
CS DQS DQS
D27
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
CS DQS DQS
D28
D29
D30
D32
D33
D34
D35
D31
PCK0-PCK6, PCK8, PCK9 -> CK : DDR2 SDRAMs D0-D35
PCK0-PCK6, PCK8, PCK9 -> CK : DDR2 SDRAMs D0-D35
PCK7 -> CK : Register
PCK7 -> CK : Register
PAR_IN
V
V
VREF
V
100K ohms
DDSPD
DD
SS
SCL
/V
0 Ohm resistor on Err_Out is not populated for
non-parity card.
The resistors on Par_In, A13, A14, A15, BA2
and the signal line of Err_Out refer to the sec-
tion: "Register Options for Unused Address
inputs"
DDQ
Signals for Address and Command
Parity Function (M393T5166AZA)
WP
PAR_IN
PAR_IN
DDR2 SDRAM
Rev. 1.8 May 2007
Serial PD
SA0 SA1 SA2
A0
Register
Register
A1
PTYERR
PTYERR
A2
Serial PD
D0 - D35
D0 - D35
D0 - D35
0 ohm
SDA
Err_Out